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授权协议 Apache-2.0
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操作系统 Windows
软件类型 开源软件
所属分类 编程语言
开源组织
地区 国产
投 递 者 OSCHINA编辑部
适用人群 未知
收录时间 2020-01-21

软件简介

tinyriscv实现的是一个微RISC-V处理器核,用verilog语言编写,只求以最简单、最通俗易懂的方式实现RISC-V指令的功能,因此没有特意去对代码做任何的优化。

tinyriscv处理器核有以下特点:

  1. 实现了RV32I指令集,通过riscv的RV32I指令兼容性测试,支持以下指令:add addi and andi auipc beq bge bgeu blt bltu bne fence_i jal jalr lb lbu lh lhu lw lui or ori sb sh sw sll slli slt slti sltiu sltu sra srai srl srli sub xor xori;
  2. 支持RV32M指令集:mul mulh mulhu mulhsu div divu rem remu;
  3. 采用三级流水线,即取指,译码、访存、执行,回写;
  4. 可以运行简单的c语言程序。
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代码

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01/21 22:26

一个从零开始写的RISC-V处理器——tinyriscv

最近两年,RISC-V这个词开始频繁的出现在各大网站和技术论坛,从芯来蜂鸟E203、阿里平头哥玄铁910、NXP织女星RV32M1、再到兆易创新GD32VF103、沁恒CH32V103等等,国内外涌现出了一大批RISC-V处理器。今天分享一位大佬从零开始写的极简、非常易懂的RISC-V处理器核,从一个FPGA小白的角度,来学习如何实现一个RISC-V处理器。 开源地址 该项目的Gitee开源地址: https://gitee.com/liangkangnan/tinyriscv (长按前往项目地址) 这个...

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发表于硬件 & IoT专区
2020/08/05 16:10

一个从零开始写的极简、非常易懂的RISC-V处理器核

与本项目配套的设计文档《从零开始写RISC-V处理器》,目前已经更新完第三章硬件篇,开始更新软件篇。 1.初衷 本开源项目的初衷是本人想入门RISC-V,熟悉RISC-V的指令内容和汇编语法。 本人对RISC-V很感兴趣,很看好RISC-V的发展前景,觉得RISC-V就是CPU中的Linux。由于RISC-V是这两年才开始迅速发展的,因此关于RISC-V的学习参考资料目前还很少,特别是适合入门的资料,因此学习起来进度很缓慢,于是萌生了自己从零开始写RISC-...

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2020/08/09 11:24

一个小型RISC-V开源处理器核介绍!

【编者推荐语】最近看到了一个开源的RISC-V处理器设计,仅仅5000行左右的verilog代码,功能却非常完善。代码全部为手动设计的verilog代码,可读性非常强。设计者完成了包括CPU内核设计,总线设计,debug模块设计,外设模块设计,以及相关的软件设计,测试模块设计。整个项目的完成度非常高,值得FPGA入门后想要再提高的人来学习。 下面是对这个下面的介绍说明(来自项目的README文件)。 1.初衷 本开源项目的初衷是本人想入门R...

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2020/08/13 00:32

从零开始写RISC-V处理器

从零开始写RISC-V处理器 前言 第一次听到RISC-V这个词大概是两年前,当时觉得它也就是和MIPS这些CPU架构没什么区别,因此也就不以为然了。直到去年,RISC-V这个词开始频繁地出现在微信和其他网站上,此时我再也不能无动于衷了,于是开始在网上搜索有关它的资料,开始知道有SiFive这个网站,知道SiFive出了好几款RISC-V的开发板。可是最便宜的那一块开发板都要700多RMB,最后还是忍痛出手了一块。由于平时上班比较忙,所以玩这块...

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